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DDR 规范的 DC 和 AC 特性

对于任何一种接口规范的设计，首先要搞清楚系统中传输的是什么样的信号，也就是驱动器能发出什么样的信号，接收器能接受和判别什么样的信号，用术语讲，就是信号的DC和AC特性要求。

在DDR规范文件JEDEC79R的第51页[TABLE6:ELECTRICALCHARACTERISTICSANDDCOPERATINGCONDITIONS]中对DDR的DC有明确要求:VCC=+2.5V+0.2V，Vref=+1.25V±0.05V，VTT=Vref±0.04V.

在我们的实际设计中，除了要精确设计供电电源模块之外，还需要对整个电源系统进行PI仿真，而这是高速系统设计中另一个需要考虑的问题，在这里我们先不讨论它，暂时认为系统能够提供稳定的供电电源。

除DC特性外，我们还应该注意规范中提到的AC特性，所谓AC特性，就是信号在高速利转状态下所表现出的动态变化特性。DDR规范中第60页，对外于云态变化的地址信号、控制信号及数据信号分别给出了交流特性的要求。为方便读者，现把规范中对干信号交流特性的要求复制到这里，作为高速系统设计的一部分，要确保在我们的系统中，所有处于高速工作状态下的DDR信号要符合这个AC特性规范。 4代DDR之间有什么区别？电气性能测试DDR一致性测试服务热线

软件运行后，示波器会自动设置时基、垂直增益、触发等参数并进行测量，测量结果会 汇总成一个html格式的测试报告，报告中列出了测试的项目、是否通过、spec的要求、实测 值、margin等。

使用自动测试软件的优点如下所述：

•自动化的设置向导避免连接和设置错误；

•快速的测量和优化的算法减少测试时间；

•可以测试JEDEC规定的速率也可以测试用户自定义的数据速率;

•独有的自动读写分离技术简化了测试操作；

•能够多次测量并给出一个统计的结果；

•能够根据信号斜率自动计算建立/保持时间的修正值。 云南DDR一致性测试HDMI测试DDR4 和 LPDDR4 一致性测试应用软件提供了多种可以简化设计验证的关键功能。

除了DDR以外，近些年随着智能移动终端的发展，由DDR技术演变过来的LPDDR (Low-Power DDR,低功耗DDR)也发展很快。LPDDR主要针对功耗敏感的应用场景，相 对于同一代技术的DDR来说会采用更低的工作电压，而更低的工作电压可以直接减少器 件的功耗。比如LPDDR4的工作电压为1. 1V,比标准的DDR4的1.2V工作电压要低一 些，有些厂商还提出了更低功耗的内存技术，比如三星公司推出的LPDDR4x技术，更是把 外部I/O的电压降到了0.6V。但是要注意的是，更低的工作电压对于电源纹波和串扰噪 声会更敏感，其电路设计的挑战性更大。除了降低工作电压以外，LPDDR还会采用一些额 外的技术来节省功耗，比如根据外界温度自动调整刷新频率(DRAM在低温下需要较少刷 新)、部分阵列可以自刷新，以及一些对低功耗的支持。同时，LPDDR的芯片一般体积更 小，因此占用的PCB空间更小。

自动化一致性测试

因为DDR3总线测试信号多，测试参数多，测试工作量非常大，所以如果不使用自动化 的方案，则按Jedec规范完全测完要求的参数可能需要7〜14天。提供了全自动的DDR测试 软件，包括：支持DDR2/LPDDR2的N5413B软件；支持DDR3/LPDDR3的U7231B软件； 支持DDR4的N6462A软件。DDR测试软件的使用非常简便，用户只需要 按顺序选择好测试速率、测试项目并根据提示进行参数设置和连接，然后运行测试软件即可。 DDR4测试软件使用界面的例子。 DDR3和 DDR4设计分成几个方面：仿真、有源信号验证和功能测试。用于电气物理层、协议层和功能测试解决方案。

按照存储信息方式的不同，随机存储器又分为静态随机存储器SRAM(Static RAM)和 动态随机存储器DRAM(Dynamic RAM)。SRAM运行速度较快、时延小、控制简单，但是 SRAM每比特的数据存储需要多个晶体管，不容易实现大的存储容量，主要用于一些对时 延和速度有要求但又不需要太大容量的场合，如一些CPU芯片内置的缓存等。DRAM的 时延比SRAM大，而且需要定期的刷新，控制电路相对复杂。但是由于DRAM每比特数据存储只需要一个晶体管，因此具有集成度高、功耗低、容量大、成本低等特点，目前已经成为大 容量RAM的主流，典型的如现在的PC、服务器、嵌入式系统上用的大容量内存都是DRAM。寻找能够满足您的 DDR 和存储器需求的特定解决方案。电气性能测试DDR一致性测试服务热线

DDR5 一致性测试应用软件。电气性能测试DDR一致性测试服务热线

对DDR5来说，设计更为复杂，仿真软件需要帮助用户通过应用IBIS模型针对基于 DDR5颗粒或DIMM的系统进行仿真验证，比如仿真驱动能力、随机抖动/确定性抖动、寄 生电容、片上端接ODT、信号上升/下降时间、AGC(自动增益控制)功能、4taps DFE(4抽头 判决反馈均衡)等。

DDR的读写信号分离

对于DDR总线来说，真实总线上总是读写同时存在的。规范对于读时序和写时序的 相关时间参数要求是不一样的，读信号的测量要参考读时序的要求，写信号的测量要参考写 时序的要求。因此要进行DDR信号的测试，第一步要做的是从真实工作的总线上把感兴 趣的读信号或者写信号分离出来。JEDEC协会规定的DDR4总线的 一个工作时 序图(参考资料： JEDEC STANDARD DDR4 SDRAM,JESD79-4),可以看到对于读和写信 号来说，DQS和DQ间的时序关系是不一样的。 电气性能测试DDR一致性测试服务热线

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