我们可以简单地从微观上讲解这个步骤。
在涂满光刻胶的晶圆（或者叫硅片）上盖上事先做好的光刻板，然后用紫外线隔着光刻板对晶圆进行一定时间的照射。原理就是利用紫外线使部分光刻胶变质，易于腐蚀。
溶解光刻胶：光刻过程中曝光在紫外线下的光刻胶被溶解掉，***后留下的图案和掩模上的一致。
“刻蚀”是光刻后，用腐蚀液将变质的那部分光刻胶腐蚀掉（正胶），晶圆表面就显出半导体器件及其连接的图形。然后用另一种腐蚀液对晶圆腐蚀，形成半导体器件及其电路。
***光刻胶：蚀刻完成后，光刻胶的使命宣告完成，全部***后就可以看到设计好的电路图案。
而100多亿个晶体管就是通过这样的方式雕刻出来的，晶体管可用于各种各样的数字和模拟功能，包括放大，开关，稳压，信号调制和振荡器。
晶体管越多就可以增加处理器的运算效率；再者，减少体积也可以降低耗电量；***，芯片体积缩小后，更容易塞入行动装置中，满足未来轻薄化的需求。
简而言之，晶体管就是个可变电阻。绝缘栅双极型晶体管批发
电子在p级往接导线的那一边移动，他们抛弃了原来贴近于n极这一边的空穴，转而移动到了贴近电线那一边的空穴，那么n极的电子就会和接近于n这边的空穴结合，源源不断。这其实是扩散运动。不是电场力不是推力。
而反过来就不能导通了，这里**关键的一点就是没有电流。p极接的那根电线不会源源不断的输出电子的（根本就没有电子会出来）。这样的话只有电场力存在，电场力会把中间的耗尽层加宽，那么就更加不可能发生扩散运动了。
现在再来看晶体管就会变得非常简单。晶体管是PNP或者NPN。连接c极和e极时，不会导通，没有电流，所以电线里根本就不会有电子出来。而在电场力的作用下，有一边的耗尽层肯定加宽，所以不管正接还是反接都不会导通。
然而如果在其中的b极和e极连接。那么b e之间就是一个二极管电子就可以通过，然而电子一通过pn结，就被吸引到c极去了，c极的电流就会非常大。这就实现了放大。
长沙晶体管供应场效应晶体管的三个极，分别是源极、栅极和漏极。
ST微电子0.25μm SiGe BICMOS 技术中的双极性晶体管设计介绍 *
在ST微电子0.25µm SiGe BICMOS技术(B7RF)中，异质结双极晶体管(HBT)的建模是基于HICUM的。 该模型在要求高集电极电流密度的高频射频应用中特别有用。 这种紧凑和可扩展的模型比改进的Spice Gummel-Poon模型具有更高的精度，并考虑了自热效应。
典型的高压HBT的频率转换和电流增益β AC 如图1所示。 柯克效应（Kirk effect）的影响在右边灰色地方可以看到，结果产生强f T ，以及在高偏置水平下β增益的崩溃。 从物理的角度来看，这种影响是由于基极深度的增加（基/集电极结向下移动），这与载流子注入相反。
晶体管因为有以下的优点，因此可以在大多数应用中代替真空管：
没有因加热阴极而产生的能量耗损，应用真空管时产生的橙光是因为加热造成，有点类似传统的灯泡。
体积小，重量低，因此有助于电子设备的小型化。
工作电压低，只要用电池就可以供应。
在供电后即可使用，不需加热阴极需要的预热期。
可透过半导体技术大量的生产。
放大倍数大。
平面晶体管
平面工艺是60年代发展起来的一种非常重要的半导体技术。该工艺是在Si半导体芯片上通过氧化、光刻、扩散、离子注入等一系列流程，制作出晶体管和集成电路。凡采用所谓平面工艺来制作的晶体管，都称为平面晶体管。
晶体管能用于放大弱信号，用作振荡器或开关。
三极管放大原理
值得注意的是，对于三极管放大作用的理解，必须切记一点：根据能量守恒定律，能量不会无缘无故的产生，所以，三极管一定不会产生能量。
晶体管的内部工作原理就是对流过基极与发射极之间的电流进行不断地监视，并控制集电极-发射极间电流源，使基极-发射极间电流的数十至数百倍（因晶体管种类而异）的电流在集电极与发射极之间流动。也就是说，晶体管是用基极电流来控制集电极-发射极电流的器件。晶体三级管的内部工作原理如下图3所示。
晶体管是一种调节电流或电压的装置，作为集成电路中的基本元素，集成电路由大量与电路互连的晶体管组成。湖南晶体管销售代理
交流放大倍数是指在交流状态下，晶体管集电极电流变化量△IC与基极电流变化量△IB的比值，用hfe或β表示。绝缘栅双极型晶体管批发
可以说，在晶圆制造中，直径 30 厘米的圆形硅晶薄片穿梭在各种极端精密的加工设备之间，由它们在硅片表面制作出只有发丝直径千分之一的沟槽或电路。热处理、光刻、刻蚀、清洗、沉积……每块晶圆要昼夜无休地被连续加工两个月，经过成百上千道工序，**终集成了海量的微小电子器件，经切割、封装，成为信息社会的基石——芯片。
这是一个 Top-down View 的 SEM 照片，可以非常清晰的看见 CPU 内部的层状结构，越往下线宽越窄，越靠近器件层。
这是 CPU 的截面视图，可以清晰地看到层状的 CPU 结构，由上到下有大约 10 层，其中**下层为器件层，即是 MOSFET 晶体管。
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