平面晶体管的基区一般都是采用杂质扩散技术来制作的，故其中杂质浓度的分布不均匀（表面高，内部低），将产生漂移电场，对注入到基区的少数载流子有加速运动的良好作用。所以平面晶体管通常也是所谓漂移晶体管。这种晶体管的性能**优于均匀基区晶体管。
传统的平面型晶体管技术，业界也存在两种不同的流派，一种是被称为传统的体硅技术(Bulk SI)，另外一种则是相对较新的绝缘层覆硅(SOI)技术。平面Bulk CMOS和FD-SOI曾在22nm节点处交锋了。其中，Bulk CMOS是最***的，也是成本比较低的一种选择，因此它多年来一直是芯片行业的支柱。但随着技术的推进，Bulk CMOS晶体管容易出现一种被称为随机掺杂波动的现象。Bulk CMOS晶体管也会因此可能会表现出与其标称特性不同的性能，并且还可能在阈值电压方面产生随机差异。解决这个问题的一种方法是转向完全耗尽的晶体管类型，如FD-SOI或FinFET。
晶体管利用电讯号来控制自身的开合，而且开关速度可以非常快。成都电子管晶体管
单结晶体管极性的判断
单结晶体管极性的判断方法常有两种，一种是从外观来看，另一种是用万用表来测量。
（1）外观判断法。从外观上看，引脚与外壳相通的电极，一般是b1极；与凸耳相靠近的电极一般为e极，如图5-8所示。
（2）万用表判断法
1）发射极e的判断
单结晶体管，也叫双基极二极管，有e、b1、b2三个电极，其三个管脚的极性可用万用表的R×1K挡来进行判断。测任意两个管脚的正向电阻和反向电阻，直到测得的正反向电阻都基本不变时（一般约10KΩ～30 KΩ，不同型号的管阻值有差异），这两个管脚就是两个基极，剩下的另一个管脚就是发射极e。
2）b1、b2电极的判断
在判断出发射极e的基础上，万用表量程置于R×1K挡，黑表笔发射极，红表笔分别接另外两个极，万用表两次均会导通，两次测量中，电阻大的一次，红表笔接的就是单结晶体管的b1极。
徐州单结晶体管晶体管按工作频率可分为低频晶体管、高频晶体管和超高频晶体管等。
在现代电子系统设计中，随着集成电路集成度越来越高，在设计电路时，晶体三极管作为逻辑开关的使用非常***。晶体三极管作为开关管使用时，是利用了让三极管工作在饱和模式下，也即是在最左侧时BE关闭，在最右侧时CE导通。上面的水龙头例子对三极管做了较为清晰的理解，在进行电路设计时，需要有一个可以量化的设计指标，即基极电流和集电极电流的关系来做量化分析。在进行三极管的饱和状态设计时，可以采用如下公式：
式中, 是基极流入发射极的电流； 是三极管的放大倍数； 是集电极的电流。
有时候需要用晶体三极管来对输入的信号做放大处理，在电路设计中，晶体三极管想选型可以按照如下步骤进行。
(一) 、需要明确制作什么样性能的电路，也即是说，要有一个系统的电路设计的规格书；
(二) 、确定要使用电源的电压，来保证电路的正常工作；
(三) 、选择所要使用的晶体管的类型，PNP或者NPN，一般NPN型三极管使用的要多一些。应根据晶体三极管Datasheet里的比较大额定值选择，保证其不会在工作时损坏，在额定值内查看其电气特性，根据目标信号放大倍数选定合适的三极管；
研究人员展示了未来光晶体管的平台 *
纳米光子学领域的研究人员一直在努力开发光学晶体管，这是未来光学计算机的关键组件。这些设备将使用光子而不是电子来处理信息，从而减少热量并提高运行速度。但是，光子不能很好地相互作用，这对微电子工程师来说是一个大问题。俄罗斯圣光机大学（ITMO）的一组研究人员提出了解决该问题的新方法：通过创建一个平面系统将光子耦合到其他粒子，从而使它们彼此相互作用。他们的方法有望为开发未来的光学晶体管提供平台。研究成果发表在《Light: Science & Applications》上。
晶体管是一种调节电流或电压的装置，作为集成电路中的基本元素，集成电路由大量与电路互连的晶体管组成。
晶体管（transistor）是一种类似于阀门的固体半导体器件，可以用于放大、开关、稳压、信号调制 和许多其他功能。在1947年，由美国物理学家约翰·巴丁、沃尔特·布喇顿和英国物理学家威廉·肖克 利（William Shockley，1910—1989）所发明。他们也因为半导体及晶体管效应的研究获得1956年 诺贝尔物理奖。
二战之后，贝尔实验室成立了一个固体物理研究小组，他们要制造一种能替代电子管的半导体器 件。此前，贝尔实验室就对半导体材料进行了研究，发现掺杂的半导体整流性能比电子管好。因此 小组把注意力放在了锗和硅这两种半导体材料上。 晶体管通常由硅晶体制成，采用 N 和 P 型半导体层相互夹合形式。河源测试仪晶体管
晶体管的主要参数有电流放大系数、耗散功率、频率特性、集电极比较大电流、比较大反向电压等。成都电子管晶体管
场效应晶体管（FET）的截面图，其中（a）栅极为0V，（b）栅极为-0.5V，（c）栅极为-1.0V，相对于源极电压。由于栅极上没有电压，电流可以从漏极流向源极。栅极上的负电压很小，电流减小。栅极上的负电压很大，电流停止，晶体管关闭（称为夹断，因为沟道被夹紧闭合）。
如果相对于源极电压（Vgs）的小负电压施加到栅极端子，如图2（b）所示，沟道内的带负电的电子将从栅极和沟道（channel）的一个区域排斥，被称为耗尽区中的自由电子耗尽。耗尽其自由电子的一些沟道（channel）的效果是仅沟道（channel）的底部具有自由电子来传输电流，因此流过沟道（channel）的比较大电流减小。如果如图2（c）所示将更大的负电压施加到栅极端子（Vgs），则电子甚至更远离栅极被排斥，并且耗尽区域一直延伸穿过沟道。当耗尽区一直延伸穿过沟道时，没有自由电子携带电流;此时可以说FET被夹断，发生这种情况的栅极电压称为夹断电压（pinch-off voltage (VP)）。当栅极电压（Vgs）设置为或低于夹断电压时，则FET处于“关断”状态。
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