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2.主要的输出选项是CMOS(互补金属氧化物半导体)、LVDS(低压差分信令)，以及CML(电流模式逻辑) [2]。3.要考虑的问题包括：功耗、瞬变、数据与时钟的变形，以及对噪声的抑制能力 [2]。4.对于布局的考虑也是转换输出选择中的一个方面，尤其当采用LVDS技术时。 当设计者有多种ADC选择时，他们必须考虑采用哪种类型的数字数据输出：CMOS(互补金属氧化物半导体)、LVDS(低压差分信令)，还是CML(电流模式逻辑)。ADC中所采用的每种数字输出类型都各有优缺点，设计者应结合自己的应用来考虑。这些因素取决于ADC的采样速率与分辨率、输出数据速率，以及系统设计的功率要求，等等 [2]。对于单极性D/A转换，模拟输出的理想值为零伏点。金山区通用数模转换器批量定制

转换精度1、分辨率A/D转换器的分辨率以输出二进制（或十进制）数的位数来表示。它说明A/D转换器对输入信号的分辨能力。从理论上讲，n位输出的A/D转换器能区分2n个不同等级的输入模拟电压，能区分输入电压的**小值为满量程输入的1/2n。在比较大输入电压一定时，输出位数愈多，分辨率愈高。例如A/D转换器输出为8位二进制数，输入信号比较大值为5V，那么这个转换器应能区分出输入信号的**小电压为19.53mV [6]。2、转换误差转换误差通常是以输出误差的比较大值形式给出。它表示A/D转换器实际输出的数字量和理论上的输出数字量之间的差别。常用比较低有效位的倍数表示。例如给出相对误差不大于±LSB/2，这就表明实际输出的数字量和理论上应得到的输出数字量之间的误差小于比较低位的半个字 [6]。静安区加工数模转换器怎么样主要的输出选项是CMOS(互补金属氧化物半导体)、LVDS(低压差分信令)，以及CML(电流模式逻辑) [2]。

间接ADC是先将输入模拟电压转换成时间或频率，然后再把这些中间量转换成数字量，常用的有中间量是时间的双积分型ADC [5]。并联比较型ADC：由于并联比较型ADC采用各量级同时并行比较，各位输出码也是同时并行产生，所以转换速度快是它的突出优点，同时转换速度与输出码位的多少无关。并联比较型ADC的缺点是成本高、功耗大。因为n位输出的ADC，需要2n个电阻，（2n－1）个比较器和D触发器，以及复杂的编码网络，其元件数量随位数的增加，以几何级数上升。所以这种ADC适用于要求高速、低分辩率的场合 [5]。

模拟信号在时域上是连续的，因此可以将它转换为时间上连续的一系列数字信号。这样就要求定义一个参数来表示新的数字信号采样自模拟信号速率。这个速率称为转换器的采样率（samplingrate）或采样频率（samplingfrequency） [2]。可以采集连续变化、带宽受限的信号（即每隔一时间测量并存储一个信号值），然后可以通过插值将转换后的离散信号还原为原始信号。这一过程的精确度受量化误差的限制。然而，*当采样率比信号频率的两倍还高的情况下才可能达到对原始信号的忠实还原，这一规律在采样定理有所体现 [2]。数模转换器，又称D/A转换器，简称DAC，它是把数字量转变成模拟的器件。

一些早期的转换器的响应类型呈对数关系，由此来执行A-law算法或μ-law算法编码。误差模拟数字转换器的误差有若干种来源。量化错误和非线性误差（假设这个模拟数字转换器标称具有线性特征）是任何模拟数字转换中都存在的内在误差。也有一种被称作孔径错误（aperture error），它是由于时钟的不良振荡，且常常在对时域信号数字化的过程中出现。这种误差用一个称为“比较低有效位”的参数来衡量。采样率模拟信号在时域上是连续的，因此可以将它转换为时间上连续的一系列数字信号。这样就要求定义一个参数来表示新的数字信号采样自模拟信号速率。这个速率称为转换器的采样率或采样频率。对于双极性D/A转换，理想值为负域满量程。徐汇区加工数模转换器推荐货源

D/A转换器的转换精度与D/A转换器的集成芯片的结构和接口电路配置有关。金山区通用数模转换器批量定制

混叠所有的模拟数字转换器以每隔一定时间进行采样的形式进行工作。因此，它们的输出信号只是对输入信号行为的不完全描述。在某一次采样和下一次采样之间的时间段，**根据输出信号，是无法得知输入信号的形式的。如果输入信号以比采样率低的速率变化，那么可以假定这两次采样之间的信号介于这两次采样得到的信号值。然而，如果输入信号改变过快，则这样的假设是错误的。如果模拟数字转换器产生的信号在系统的后期，通过数字模拟转换器，则输出信号可以忠实地反映原始信号。如经过输入信号的变化率比采样率大得多，则是另一种情况，模拟数字转换器输出的这种“假”信号被称作“混叠”。混叠信号的频率为信号频率和采样率的差。例如，一个2千赫兹的正弦曲线信号在采样率在1.5千赫兹采样率的转换后，会被重建为500赫兹的正弦曲线信号。这样的问题被称作“混叠”。金山区通用数模转换器批量定制

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