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混叠所有的模拟数字转换器以每隔一定时间进行采样的形式进行工作。因此，它们的输出信号只是对输入信号行为的不完全描述。在某一次采样和下一次采样之间的时间段，**根据输出信号，是无法得知输入信号的形式的。如果输入信号以比采样率低的速率变化，那么可以假定这两次采样之间的信号介于这两次采样得到的信号值。然而，如果输入信号改变过快，则这样的假设是错误的。如果模拟数字转换器产生的信号在系统的后期，通过数字模拟转换器，则输出信号可以忠实地反映原始信号。如经过输入信号的变化率比采样率大得多，则是另一种情况，模拟数字转换器输出的这种“假”信号被称作“混叠”。混叠信号的频率为信号频率和采样率的差。例如，一个2千赫兹的正弦曲线信号在采样率在1.5千赫兹采样率的转换后，会被重建为500赫兹的正弦曲线信号。这样的问题被称作“混叠”。和权电阻网络比较，由于它只有R、2R两种阻值，从而克服了权电阻阻值多，且阻值差别大的缺点 [1]。崇明区本地数模转换器量大从优

输入时其输出值与理想输出值(满量程)之间的偏差表示，一般也用LSB的份数或用偏差值相对满量程的百分数来表示。非线性误差D/A转换器的非线性误差定义为实际转换特性曲线与理想特性曲线之间的比较大偏差，并以该偏差相对于满量程的百分数度量。在转换器电路设计中，一般要求非线性误差不大于±1/2LSB。并行数模转换数模转换有两种转换方式：并行数模转换和串行数模转换。图1为典型的并行数模转换器的结构。虚线框内的数码操作开关和电阻网络是基本部件。普陀区本地数模转换器生产企业D/A转换器基本上由4个部分组成，即权电阻网络、运算放大器、基准电源和模拟开关。

间接ADC是先将输入模拟电压转换成时间或频率，然后再把这些中间量转换成数字量，常用的有中间量是时间的双积分型ADC [5]。并联比较型ADC：由于并联比较型ADC采用各量级同时并行比较，各位输出码也是同时并行产生，所以转换速度快是它的突出优点，同时转换速度与输出码位的多少无关。并联比较型ADC的缺点是成本高、功耗大。因为n位输出的ADC，需要2n个电阻，（2n－1）个比较器和D触发器，以及复杂的编码网络，其元件数量随位数的增加，以几何级数上升。所以这种ADC适用于要求高速、低分辩率的场合 [5]。

即0111...111到1000 ...000之间的转换，此时所有电流单元开关都有开/关互换的动作。假设单个电流单元的标准偏差为σ(I)，根据统计学原理，可以简单的求得**差DNL为(2N _1)1/2*σ(I)/IOo。 INL偏差和Unary数模转换器是一样的。分段组合由前面的分析可知Unary译码方式比二进制权重方式能够实现更高的精度，但是其数字译码电路的复杂性以及功耗在高分辨率的要求下是以2的指数的方式增大，所以变的难以接受。对于更高精度的数模转换器，一般用两种方式相结合的方式来实现，即分段组合法方式（Segmented Architecture）。其中MSB部分由Unary方式来实现，达到高分辨率，LSB部分由Binary Weighted方式来实现，以节省Digital部分的面积。可以采集连续变化、带宽受限的信号，然后可以通过插值将转换后的离散信号还原为原始信号。

是基本部件。图中装置通过一个模拟量参考电压和一个电阻梯形网络产生以参考量为基准的分数值的权电流或权电压；而用由数码输入量控制的一组开关决定哪一些电流或电压相加起来形成输出量。所谓“权”，就是二进制数的每一位所**的值。例如三位二进制数“111“,右边第1位的“权”是 20/23=1/8；第2位是21/23=1/4；第3位是22/23=1/2。位数多的依次类推。图2为这种三位数模转换器的基本电路,参考电压VREF在R1、R2、R3中产生二进制权电流,电流通过开关。这样就要求定义一个参数来表示新的数字信号采样自模拟信号速率。青浦区质量数模转换器怎么样

这一过程的精确度受量化误差的限制。崇明区本地数模转换器量大从优

这种转换器的基本原理是把输入的模拟信号按规定的时间间隔采样，并与一系列标准的数字信号相比较，数字信号逐次收敛，直至两种信号相等为止。然后显示出**此信号的二进制数，模拟数字转换器有很多种，如直接的、间接的、高速高精度的、超高速的等。每种又有许多形式。同模拟数字转换器功能相反的称为“数字模拟转换器”，亦称“译码器”，它是把数字量转换成连续变化的模拟量的装置，也有许多种和许多形式 [3]。模数转换一般要经过采样、量化和编码这几个步骤 [4]。崇明区本地数模转换器量大从优

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