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数字信号的带宽(Bandwidth)

在进行数字信号的分析和测试时，了解我们要分析的数字信号的带宽是很重要的一点，它决定了我们进行电路设计时对PCB走线和传输介质传输带宽的要求，也决定了测试对仪表的要求。

数字信号的带宽可以大概理解为数字信号的能量在频域的一个分布范围，由于数字信号不是正弦波，有很多高次谐波成分，所以其在频域的能量分布是一个比较复杂的问题。

传统上做数字电路设计的工程师习惯根据信号的5次谐波来估算带宽，比如如果信号的数据速率是100Mbps,其快的0101的跳变波形相当于50MHz的方波时钟，这个方波时钟的5次谐波成分是250MHz,因此信号的带宽大概就在250MHz以内。这种方法看起来很合理，因为5次谐波对于重建信号的基本波形形状是非常重要的，但这种方法对于需要进行精确波形参数测量的场合来说就不太准确了。比如同样是50MHz 的信号，如果上升沿很陡接近理想方波，其高次谐波能量就比较大；而如果上升沿很缓接近 正弦波，其高次谐波能量就很小。
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我们经常使用到的总线根据数据传输方式的不同，可以分为并行总线和串行总线。

并行总线是数字电路中早也是普遍采用的总线结构。在这种总线上，数据线、地址线、控制线等都是并行传输，比如要传输8位的数据宽度，就需要8根数据信号线同时传输；如果要传输32位的数据宽度，就需要32根数据信号线同时传输。除了数据线以外，如果要寻址比较大的地址空间，还需要很多根地址线的组合来不同的地址空间。图1.7是一个典型的微处理器的并行总线的工作时序，其中包含了1根时钟线、16根数据线、16根地址线以及一些读写控制信号。 浙江校准数字信号测试数字信号抖动的成因（Root Cause of Jitter）;

通常情况下预加重技术使用在信号的发送端，通过预先对信号的高频分量进行增强来 补偿传输通道的损耗。预加重技术由于实现起来相对简单，所以在很多数据速率超过 1Gbps 的总线中使用，比如PCle,SATA 、USB3 .0 、Displayport等总线中都有使用。当 信号速率进一步提高以后，传输通道的高频损耗更加严重，靠发送端的预加重已经不太 够用，所以很多高速总线除了对预加重的阶数进一步提高以外，还会在接收端采用复杂的均 衡技术，比如PCle3.0 、SATA Gen3 、USB3.0 、Displayport HBR2 、10GBase-KR等总线中都 在接收端采用了均衡技术。采用了这些技术后，FR-4等传统廉价的电路板材料也可以应用 于高速的数字信号传输中，从而节约了系统实现的成本。

为了提高串行数据传输的可靠性，现在很多更高速率的数字接口采用对数据进行编码后再做并/串转换的方式。编码的方式有很多，如8b/9b编码、8b/10b编码、64b/66b编码、128b/130b编码等，下面以当下流行的ANSI8b/10b编码为例进行介绍。

在ANSI8b/10b编码方式中，8bit的数据先通过相应的编码规则转换成10bit的数据，再进行并/串转换；接收端收到信号后先把串行数据进行串/并转换得到10bit的数据，再通过10bit到8bit的解码得到原始传输的8bit数据。因此，如果发送端并行侧的数据速率是8bit×100Mbps,通过8b/10b编码和并/串转换后的串行侧的数据速率就是1bit×1Gbps。8b/10b编码方法早由IBM发明，后来成为ANSI标准的一部分(ANSIX3.230-1994,clause11),并在通信和计算机总线上广泛应用。表1.1是ANSI8b/10b编码表的一部分，以数据0x00为例， 数字信号取值是散的，通过数学方法对原有信号处理，编码成二进制信号后，再载波的方式发送编码后的数字流。

为了提高信号在高速率、长距离情况下传输的可靠性，大部分高速的数字串行总线都会采用差分信号进行信号传输。差分信号是用一对反相的差分线进行信号传输，发送端采用差分的发送器，接收端相应采用差分的接收器。图1.13是一个差分线的传输模型及真实的差分PCB走线。

采用差分传输方式后，由于差分线对中正负信号的走线是紧密耦合在一起的，所以外界噪声对于两根信号线的影响是一样的。而在接收端，由于其接收器是把正负信号相减的结果作为逻辑判决的依据，因此即使信号线上有严重的共模噪声或者地电平的波动，对于的逻辑电平判决影响很小。相对于单端传输方式，差分传输方式的抗干扰、抗共模噪声能力 提高。 数字总线采用的时钟 分配方式大体上可以分为3类，即并行时钟、嵌入式时钟、前向时钟，各有各的应用领域。甘肃数字信号测试眼图测试

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什么是数字信号(DigitalSignal)

典型的数字设备是由很多电路组成来实现一定的功能的，系统中的各个部分主要通过数字信号的传输来进行信息和数据的交互。

数字信号通过其0、1的逻辑状态的变化来一定的含义，典型的数字信号用两个不同的信号电平来分别逻辑0和逻辑1的状态(有些更复杂的数字电路会采用多个信号电平实现更多信息的传输)。真实的世界中并不存在理想的逻辑0、1状态，所以真实情况下只是用一定的信号电平的电压范围来相应的逻辑状态。比如图1.1中，当信号的电压低于判决阈值(中间的虚线部分)的下限时逻辑0状态，当信号的电压高于判决阈值的上限时逻辑1状态。 甘肃数字信号测试眼图测试