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数字信号测试基本参数
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数字信号基础单端信号与差分信号(Single-end and Differential Signals)

数字总线大部分使用单端信号做信号传输,如TTL/CMOS信号都是单端信号。所谓单端信号,是指用一根信号线的高低电平的变化来进行0、1信息的传输,这个电平的高低变化是相对于其公共的参考地平面的。单端信号由于结构简单,可以用简单的晶体管电路实现,而且集成度高、功耗低,因此在数字电路中得到的应用。是一个单端信号的传输模型。

当信号传输速率更高时,为了减小信号的跳变时间和功耗,信号的幅度一般都会相应减小。比如以前大量使用的5V的TTL信号现在使用越来越少,更多使用的是3.3V/2.5V/1.8V/1.5V/1.2V的LVTTL电平,但是信号幅度减小带来的问题是对噪声的容忍能力会变差一些。进一步,很多数字总线现在需要传输更长的距离,从原来芯片间的互连变成板卡间的互连甚至设备间的互连,信号穿过不同的设备时会受到更多噪声的干扰。更极端的情况是收发端的参考地平面可能也不是等电位的。因此,当信号速率变高、传输距离变长后仍然使用单端的方式进行信号传输会带来很大的问题。图1.12是一个受到严重共模噪声干扰的单端信号,对于这种信号,无论接收端的电平判决阈值设置在哪里都可能造成信号的误判。
波形参数测试室数字信号测试常用的测量方法,随着数字信号速率的提高,波形参数的测量方法越来越不适用了。通信数字信号测试热线

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简单的去加重实现方法是把输出信号延时一个或多个比特后乘以一个加权系数并和 原信号相加。一个实现4阶去加重的简单原理图。

去加重方法实际上压缩了信号直流电平的幅度,去加重的比例越大,信号直流电平被压缩得越厉害,因此去加重的幅度在实际应用中一般很少超过-9.5dB。做完预加重或者去加重的信号,如果在信号的发送端(TX)直接观察,并不是理想的眼图。图1.31所示是在发送端看到的一个带-3.5dB预加重的10Gbps的信号眼图,从中可以看到有明显的“双眼皮”现象。 通信数字信号测试热线数字信号的建立/保持时间(Setup/Hold Time);

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这种并/串转换方法由于不涉及信号的编解码,结构简单,效率较高,但是需要收发端进行精确的时钟同步以控制信号的复用和解复用操作,因此需要专门的时钟传输通道,而且串行信号上一旦出现比较大的抖动就会造成串/并转换的错误。

因此,这种简单的并/串转换方式一般用于比较关注传输效率的芯片间的短距离互连或者一些光端机信号的传输中。另外,由于信号没有经过任何编码,信号中可能会出现比较长的连续的0或者连续的1,因此信号必须采用直流耦合方式,收发端一旦存在比较大的共模或地噪声,会严重影响信号质量,因此这种并/串转换方式用于电信号传输时或者传输速率不太高(通常<1Gbps),或者传输距离不太远(通常<50cm)的场合。

数字信号的抖动(Jitter)

抖动的概念

抖动(Jitter)是数字信号,尤其是高速数字信号的一个非常关键的概念。如图1.40所 示,抖动反映的是数字信号偏离其理想位置的时间偏差。

高频数字信号的比特周期都非常短,一般为几百ps甚至几十ps,很小的抖动都会造成信号采样位置的变化从而造成数据误判,所以高频数字信号对于抖动都有严格的要求。抖动这个概念说起来简单,但实际上仔细研究起来是非常复杂的,关于其概念的理解有以下几个需要注意的方面:
数字信号处理系统架构分析;

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数字信号的时钟分配(ClockDistribution)

前面讲过,对于数字电路来说,目前绝大部分的场合都是采用同步逻辑电路,而同步逻辑电路中必不可少的就是时钟。数字信号的可靠传输依赖于准确的时钟采样,一般情况下发送端和接收端都需要使用相同频率的工作时钟才可以保证数据不会丢失(有些特殊的应用中收发端可以采用大致相同频率工作时钟,但需要在数据格式或协议层面做些特殊处理)。为了把发送端的时钟信息传递到接收端以进行正确的信号采样,数字总线采用的时钟分配方式大体上可以分为3类,即并行时钟、嵌入式时钟、前向时钟,各有各的应用领域。 数字信号的带宽(Bandwidth);通信数字信号测试热线

数字信号幅度测试的定义;通信数字信号测试热线

克劳德高速数字信号测试实验室

  数字信号测试方法:

需要特别注意,当数字信号的电压介于判决阈值的上限和下限之间时,其逻辑状态是不 确定的状态。所谓的“不确定”是指如果数字信号的电压介于判决阈值的上限和下限之间, 接收端的判决电路有可能把这个状态判决为逻辑0,也有可能判决为逻辑1。这种不确定是  我们不期望的,因此很多数字电路会尽量避免用这种不确定状态进行信号传输,比如会用一  个同步时钟只在信号电平稳定以后再进行采样。


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